ADS（Advanced Design system）良率分析（Yield）、良率优化（YieldOptim）

最新推荐文章于 2023-08-04 16:37:58 发布
菜鸡渣渣一个 最新推荐文章于 2023-08-04 16:37:58 发布
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分类专栏： ADS（Advanced Design system）有关 文章标签： ads软件 射频 仿真器
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前言

先进设计系统 Advanced Design system（ADS）Agilent Technologies 是领先的电子设计自动化软件，适用于射频、微波和信号完整性应用。

原理分析

我们使用软件虽然能够设计出如下低通滤波器电路，但是在实际生产中，会由于PCB精度和元器件精度而导致电路性能指标达不到要求，例如较好的高频电容和高频电感，精度为5%或10%，当个别元器件精度较差达到极值时，此电路为不合格品。

前面的文章我们分析了误差和敏感度，那么我们怎么得到整个电路的良品率？也就是说，在采用这个精度的元器件的电路中，有多少的电路是合格品？
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良率分析

仿真设置

添加良率分析的控件，以下两个都要添加进去。
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设置Yield的仿真次数。
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设置YieldSpec的参数。设置查看的是S参数中的S11参数，同时最大值为-15，以及变量是频率，范围是0.01GHz到0.2GHz。
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添加完成的原理图如下。
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仿真结果

点击仿真按钮后，在结果图中添加一个数据表。添加的参数是Yield。
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得到当前的良率为63.6%。
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良率优化

如果电路的良品率达不到要求，我们可以使用ADS中的良率优化功能，对良率进行优化。

仿真设置

先要对元器件的取值范围进行修改。双击元器件，选择对应的选项。
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对元器件的优化取值范围进行修改。对于L1和L3，范围设置为10nH-50nH，对于L2，范围设置为10nH-150nH，对于C1和C3，范围设置为10pF-50pF。
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添加良率优化的控件。
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修改默认的迭代次数为50。
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设置好后的原理图。在前面良率分析那一节中，保留良率分析参数控件，也就是YIELD SPEC，而把良率分析控件YIELD禁用。
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仿真结果

点击仿真按钮后，在结果图中添加一个数据表。添加的两个参数，分别是优化前和优化后的良率。
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可以看到良率从60提高到了92。
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选择Update，就可以把数据更新。
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更新后对应的参数。
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从S11参数的新曲线中可以得出，优化后，S11在通带0.01GHz-0.2GHz中，满足小于-15dB的指标。
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累积晶圆生产良品率
12-09
在晶圆完成所有的生产工艺后，第一个主要良品率被计算出来了。对此良品率有多种不同的叫法，如Fab良率(Fab Yield)、生产线良率、累积晶圆厂良率或CUM良率。 晶圆厂CUM良率用一个百分比来表示，可通过两种不同的计算方法得到。一种是用完成生产的晶圆总数除以总投入片数。这种简单的计算方法在实际上很少被使用。因为大部分的晶圆生产线同时生产多种不同类型的电路。不同类型的电路有不同的特征工艺尺寸和密度参数。一条晶圆生产线经常是生产一系列不同的产品，每一种产品都有其各自不同数量的工艺步骤和难度水平。在这种情况下，将会针对每一类产品计算一个合成良率。 一条晶圆生产线上会存在有大量
FT-Yield-Report-Generator:FT良率月报自动生成工具
07-14
FT-Yield-Report-Generator 良率月报自动生成工具 人生苦短，必须偷懒 概述 自动绘制系统中的PareTo柱状图和TrendChart趋势图 自动生成本月所有产品的Summary 自动绘制每位工程师的Summary柱状图 例子 PareTo柱状图： TrendChart趋势图： Summary柱状图： 使用方法 在Tango系统中抓取本月的所有lot信息，补全Au/Cu后，[注1]追加在alq.csv中。 确保alq.csv按照日期递增排序。 在Tango中抓取本月的VendorLot Report，另存为./month/VendorLot.csv，注意month必须按照格式。 运行go.py，按格式输入month，得到所有图表和Summary。 出现以下4种情况说明binList.csv相应的部分需要维护： i. 图片输出到unknown文件夹——需修改工程师名。
如何快速提高产品良率
12-09
摘要：现在的良率（yield）管理方法可以比过去达到更高的良率水平以及更快地实现稳定的生产。将来新的管理方法一定能够达到更高的水平，而且成本更低。 现在的半导体制造要求比过去任何时候都要高。为了满足市场的需要，半导体公司必须能够更及时和以更低的成本大批量生产更复杂的产品。为此，客户要求制造商能够采用全新的良率管理方法，达到比以前更高的良率水平，而且能够更快地实现稳定生产。　　反过来，新的良率管理方法取决于更广泛和更深入的工程分析方法，这些分析方法可以帮助半导体公司作出更加准确的判断，更快地达到稳定的良率。通过持续的良率“学习”，自动制造技术则可以更加有效地利用这些分析结果，它不仅可以将各
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AEC-Q002B1：2012 统计良率分析指南 - 完整英文电子版（6页）.rar
最新发布
11-12
完整英文电子版AEC-Q002B1：2012 Guidelines for Statistical Yield Analysis - （统计良率分析指南 ）。本指南旨在用作检测和去除异常大量材料的方法，从而确保供应的 IC 符合 AEC-Q100 或 AEC-Q101 的质量和可靠性。本指南中描述的原则适用于封装或未封装芯片。
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【过往记忆大数据】已开通技术交流及招聘求职内推群，加微信号fangzhen0219为好友后入群。本文全文篇幅1万字左右，从数据结构到Java再到大数据都有整理，可以先收藏起来，查漏补缺...
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回答: 当在ADS仿真中出现报错"yield"时，通常表示仿真过程中出现了错误或者无法达到预期的结果。这可能是由于多种原因引起的，比如仿真设置错误、参数设置不正确、电路设计问题等。为了解决这个问题，可以尝试以下几个步骤： 1. 检查仿真设置：确保仿真设置正确，包括频率范围、仿真时间等参数是否合理。 2. 检查电路设计：检查电路设计是否符合要求，包括元件连接是否正确、元件参数是否准确等。 3. 检查参数设置：检查参数设置是否正确，包括元件参数、仿真参数等是否符合要求。 4. 检查错误信息：查看报错信息中的具体错误提示，根据错误提示进行相应的调整和修正。 如果以上步骤都没有解决问题，可以尝试重新建立原理图、重新设置仿真参数或者咨询相关专业人士以获取更详细的帮助。 #### 引用[.reference_title] - *1* [ADS仿真微带型lange耦合器学习笔记](https://blog.csdn.net/qq_36521926/article/details/128598003)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^insertT0,239^v3^insert_chatgpt"}} ] [.reference_item] - *2* *3* [ADS Circuit Design Cookbook](https://blog.csdn.net/weixin_38628101/article/details/126903374)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^insertT0,239^v3^insert_chatgpt"}} ] [.reference_item] [ .reference_list ]

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